ch3-DSP的中断控制

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ch3 DSP的中断控制
主要内容
向量表映射
PIE控制器的概述
中断源
3.1
3.2
3.3
外部中断控制寄存器
PIE配置寄存器
PIE中断寄存器
3.4
3.5
3.6
3.7
示例程序
3.1 PIE控制器的概述
中断结构： 在CPU级，28x CPU支持1个非可屏蔽中断（NMI）和16个可屏蔽的优先中断请求（INT1 – INT14，RTOSINT和DLOGINT）。28x器件有许多外设，每个外设能够产生一个或更多中断来响应外设级的许多事件。由于CPU没有足够的能力在CPU级处理所有的外设中断请求，所以需要一个集中式外设中断扩展（PIE）控制器来判断来自各个源（例如，外设和其它外部引脚）的中断请求。

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关键词：DSP login DLOG 主要内容 int